Achronix Speedster22i User Macro Guide Manuel d'utilisateur Page 92

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Registers DFFNR
Speedster22i Macro Cell Library
AchronixSemiconductorProprietary PAGE 76
Table 2-40: Function Table
Inputs Output
rn d ckn q
when sr_assertion = “unclocked’
Table 2-41: Function Table
Inputs Output
rn d ckn q
when sr_assertion = “clocked’
Verilog Instantiation Template
DFFNR #(.init(1’b0))
instance_name
(.q(user_out),
.d(user_din),
.rn(user_reset),
.ckn(user_clock));
VHDL Instantiation Template
------------- ACHRONIX LIBRARY ------------
library speedster22i;
use speedster22i.components.all;
------------- DONE ACHRONIX LIBRARY ---------
-- Component Instantiation
DFFNR_instance_name : DFFNR
generic map (
init => ‘0’)
port map (q => user_out,
d => user_din,
rn => user_reset,
ckn => user_clock);
0X X 0
1X XHold
10 0
11 1
0X 0
1X
XHold
10 0
11 1
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